Video decoding system

비디오디코딩시스템

Abstract

PURPOSE: A video decoding system is provided to form a proper interface between a rapid speed requiring area and an area which does not require rapid speed, to increase access speed of a memory by effectively managing a demand of memory, and to minimize a period of time required for memory access for compensating motion. CONSTITUTION: A video decoding system includes a variable length decoder(104) for decoding variable length of video stream and obtaining position information of DCT coefficient on a DCT block of the decoded data, an inverse quantizer(105) for performing inverse quantization by multiplying qantization matrix corresponding to the position information, qantization level determining qantization step and DCT coefficient, an inverse scan part(106) having a plurality of memories and converting and outputting DCT coefficient, which is output from the inverse quantizer, in parallel while performing inverse scan of the DCT coefficient, an inverse discrete cosine transform part(108) for performing inverse discrete cosine transform to the DCT coefficient output from the inverse scan part, a frame memory, a memory controller(124) for controlling data writing/reading of the frame memory and providing priority to demand signal of each block in a predetermined order, a motion compensating part(121) for performing compensation by picture type, and a display for outputting complete picture.
엠펙 2 메인 프로파일@하이레벨(MPEG 2 MP@HL)의 비트스트림을 디코딩하기 위한 비디오 디코딩 시스템에 관한 것으로서, 특히 VLD는 낮은 속도에서 동작시키면서도 IQ/역스캔/IDCT등의 고속 처리가 가능하도록 함으로써, 많은 회로의 감축과 적절한 클럭에서 구현하는 것이 가능하여 데이터의 처리 양과 속도가 많이 요구되는 HDTV 비디오 디코더에 적용할 수 있으며, 또한 메모리 제어부는 VLD 전의 비트스트림 라이트, 디스플레이를 위한 데이터 리드, VLD를 위한 데이타 리드, 움직임 보상된 데이터의 라이트, 움직임 보상을 위한 데이터 리드 순서로 응답하는 우선권을 줌으로써, 메모리 억세스를 효율적으로 수행하여 외부 메모리와의 인터페이싱 속도가 빨라지므로 역시 비디오 디코딩을 고속으로 수행할 수 있다. 그리고, 프레임 메모리로 SDRAM 할당시 위, 아래 슬라이스가 서로 다른 뱅크 어드레스를 가지도록 하며, 움직임 보상을 위한 데이터를 SDRAM으로부터 읽어올 때 두 슬라이스에 걸쳐 있는 데이터를 SDRAM의 인터리빙 억세스 방법에 의해 읽음으로써, 메모리 억세스 효율을 높여 HDTV 디코딩을 하기 위해 필요한 속도를 얻을 수 있다.

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